| dbo:abstract
|
- ريسك-فايف (بالإنجليزية: RISC-V) هي بنية مجموعة تعليمات (Instructions Set Architecture) حرة ومفتوحة المصدر تستند إلى مبادئ الحوسبة المحددة ريسك. خلاف مُعظم معايير بينة مجموعة التعليمات (ISA) يمكن استخدام معيار RISC-V ISA بحرية لأي غرض، ما يعني حرية كاملة في تصميم وتصنيع وبيع رقائق ريسك-فايف وبرمجتها. لا يُعتبر ريسك-فايف أول بنية مجموعة تعليمات مفتوحة، وتكمل أهميته في أنه صُمم ليستعمل على مجموعة واسعة الأجهزة. تحتوي مجموعة التعليمات أيضًا على مجموعة كبيرة من برامج الدعم، والتي تتجنب الضعف المعتاد في مجموعات التعليمات الجديدة. بدأ المشروع في عام 2010 في جامعة كاليفورنيا بـبيركلي، ولكن العديد من المساهمين هم من المتطوعين وعمال الصناعة خارج الجامعة. صُمم جهاز RISC-V ISA مع تطبيقات في العالم الحقيقي صغيرة وسريعة وقليلة الطاقة، ولكن بدون تصميم معماري أكثر من أجل أسلوب معماري دقيق معين. (ar)
- RISC-V és una arquitectura de joc d'instruccions o ISA basada en codi obert i de tipus RISC. RISC-V fou creada el 2010 per investigadors de la Universitat de Berkeley a Califòrnia. (ca)
- RISC-V (výslovnost [ˌrisk ˈfaiv]; V je římská číslice 5) je instrukční sada z rodiny RISC. Je vyvíjena od roku 2010 na Kalifornské univerzitě v Berkeley. Původně šlo o “tříměsíční projekt”, který měl vytvořit novou otevřenou instrukční sadu (architekturu) na základě existujících technologií a překonat tak omezení související s proprietárními architekturami, mezi něž patří:
* Patentová ochrana – vyšší náklady
* Provázanost mezi vlastnictvím architektury a návrhem procesorů – nemožnost změny dodavatele
* Složitost mnoha architektur – často zbytečná
* Architektura může zaniknout zároveň se společností, která ji vlastní – riziko v čase Na rozdíl od starších projektů majících rovněž za cíl vytvářet procesory jako otevřený hardware (např. a ) je RISC-V navržen pro široké použití od vestavěných systémů přes mobilní telefony až po cloudové počítače, tedy s důrazem na výkon i na spotřebu. Instrukční sada RISC-V je od počátku otevřená, nicméně velký komerční zájem vedl v roce 2015 k založení oficiální neziskové organizace RISC-V Foundation, jejímž cílem bylo podpořit počáteční přijetí RISC-V a dále tuto instrukční sadu udržovat a rozvíjet. Původní autoři a vlastníci se vzdali svých práv ve prospěch organizace. RISC-V Foundation měla 36 zakládajících členů a svými členy je nadále řízena. V roce 2020 došlo k transformaci na mezinárodní sdružení RISC-V International, které sídlí ve Švýcarsku a je zodpovědné za další vývoj architektury RISC-V. (cs)
- RISC-V, offizielle Aussprache in Englisch: „risc-five“ [rɪsk faɪv], ist eine Befehlssatzarchitektur (engl. instruction set architecture, ISA), die sich auf das Designprinzip des Reduced Instruction Set Computers (RISC) stützt. Es ist ein offener Standard, welcher der freizügigen BSD-Lizenz unterliegt. Das bedeutet, dass RISC-V nicht patentiert ist und frei verwendet werden darf. Somit ist es jedem erlaubt, RISC-V Mikroprozessoren zu entwerfen, herzustellen, weiterzuentwickeln und zu verkaufen (Open-Source-Hardware). Eine Vielzahl an Unternehmen bieten RISC-V-Hardware an oder haben diese angekündigt. Der RISC-V Befehlssatz wurde für eine Vielzahl von Anwendungsfällen entworfen. Er hat eine variable Datenwortbreite und ist erweiterbar, so dass mehr Kodierungsbits jederzeit hinzugefügt werden können. Er unterstützt drei Datenwortbreiten: 32, 64 und 128 Bit und eine Auswahl an Unterbefehlssätzen. Die Definitionen jedes Unterbefehlssatzes variieren geringfügig zwischen den drei Wortbreiten. Die Unterbefehlssätze unterstützen kompakte eingebettete Systeme, persönliche Rechner, Hochleistungsrechner mit Vektorprozessoren und Parallelrechner. Der Befehlssatzraum für den auf 128 Bit gedehnten Befehlssatz wurde reserviert, weil 60 Jahre Industrieerfahrung gezeigt haben, dass die meisten nicht wieder gut zu machenden Fehler in der Gestaltung von Befehlssätzen durch fehlenden Speicheradressraum verursacht wurden. Noch im Jahr 2016 blieb der 128-Bit-Teil des Befehlssatzes absichtlich undefiniert, da bisher wenig Erfahrung mit solch großen Speichersystemen besteht. Es gibt Vorschläge, Instruktionen mit einer variablen Breite bis zu 864 Bit zu implementieren. Das Projekt begann 2010 an der University of California, Berkeley unter der Leitung von und David A. Patterson und wird bereits von Hard- und Softwareentwicklern weltweit mitentwickelt und gefördert. Anders als andere akademische Entwürfe, die üblicherweise auf einfache Erläuterung optimiert sind, wurde der RISC-V-Befehlssatz für praktische Anwendung in Rechnern entworfen. Er besitzt Eigenschaften, die die Rechnergeschwindigkeit erhöhen, aber trotzdem die Kosten und den Energieverbrauch senken. Dies schließt eine Load/Store-Architektur, Bit-Muster, um die Multiplexer in einer CPU zu vereinfachen, vereinfachte Standard-basierte Gleitkommazahlen, einen architekturneutralen Entwurf und das Setzen des höchstwertigen Bits an eine festgelegte Position, um die Vorzeichenerweiterung zu beschleunigen, ein. Vorzeichenerweiterung wird als häufig auf dem kritischen Pfad liegend betrachtet.Seit Juni 2019 sind die Version 2.2 des Userspace-ISA und die Version 1.11 des privilegierten ISA festgelegt und ermöglichen es Software- und Hardwareherstellern diesen zu nutzen oder zu implementieren. Eine Fehlersuch-Spezifikation ist als Vorabentwurf in der Version 0.3 verfügbar. (de)
- RISC-V (risc-five ahoskatua, Kaliforniako Unibertsitatean (Berkeley, 1981) garatu ziren RISC arkitekturan oinarritutako 5.belaunaldien kopuruari dagokio. Estandar irekien agindu-multzo arkitektura da (ISA ingelesez), RISCn ezarritako printzipioetan oinarritua. Beste diseinu gehienetan ez bezala, RISC-V bidez ematen da, erabiltzeko tasarik behar ez dutenak. Zenbait konpainia RISC-V-en oinarritutako hardwarea eskaintzen dute edo iragartzen ari dira, RISC-V euskarria duten kode irekiko sistema eragileak sortu dira, eta agindu-multzoa hainbat software famatu eta tresna-katetan euskarria du. RISCren arkitektura gisa, RISC-V-ren ISA kargatze-/biltegiratze-arkitektura da. Honen koma-higikariaren implementazioa IEEE-ren 754 erabiltzen du. ISA honen ezaugarri azpimarragarrien artean, aginduetarako bit eremu kokalekuak, PUZ batean multiplexadoreen erabilera sinplifikatzeko aukeratuak, arkitektura aldetik neutroa den diseinua, eta berehalako balioen bit garrantzitsuenak leku finkoetan kokatzea zeinu-luzapenak azkartzeko. Erabilera-sorta zabal baterako diseinatuta dago agindu-multzoa. Oinarrizko agindu-multzoak berez 32 biteko agindu-luzera finkoa du, eta luzera aldakorreko luzapenak onartzen ditu ISAk, non agindu bakoitza 16 biteko edozein pakete luzera izan baitaiteke. Azpimultzoek sistema txertatu txikiak, ordenagailu pertsonalak, bektore-prozesadoreak dituzten superordenagailuak eta 19 hazbeteko eskalan muntatutako ekipo paraleloak onartzen dituzte. Agindu-multzoaren zehaztapenak 32 eta 64 biteko helbideen aldaera espazialak definitzen ditu. Zehaztapenean, 128 biteko helbide-espazio lau baten deskribapena jasotzen da, 32 eta 64 biteko aldagaien estrapolazioa bezala, baina 128 biteko ISA "ez izoztuta" nahita mantentzen da, oraindik esperientzia praktiko gutxi baitago hain memoria-sistema handiekin. Proiektua 2010ean hasi zen Kaliforniako Unibertsitatean (Berkeley), baina orain gaur egungo kolaboratzaile asko unibertsitatera afiliatu gabeko boluntarioak dira. Beste diseinu akademiko batzuk ez bezala, erakusketarako soilik optimizatu ohi direla, RISC-V-ren diseinatzaileek agindu-multzoa konputagailu praktikoetarako erabilgarria izatea nahi zuten. 2019ko ekainetik aurrera, ISA-ren erabiltzaile-espazioaren 2.2 bertsioa eta ISA pribilegiatuaren 1.11 bertsioa "izoztuta" bezala utzi dira, softwarea eta hardwarea garatzea ahalbidetuz. ISA-ren erabiltzaile-espazioaren, orain ISA ez-pribilegiatua bezala ezaguna, 20191213 bertsio gisa eguneratu, berretsi eta izoztu zen. Kanpoko arazketa-zehaztapen bat zirriborro gisa erabil daiteke, 0.13.2 bertsioan. (eu)
- RISC-V es una arquitectura de conjunto de instrucciones (ISA) de hardware libre basado en un diseño de tipo RISC (conjunto de instrucciones reducido). A diferencia de la mayoría de los conjuntos de instrucciones, el de RISC-V es libre y abierto y se puede usar sin regalías para cualquier propósito, lo que permite que cualquiera diseñe, fabrique y venda chips y software de RISC-V. Si bien no es la primera ISA de arquitectura abierta, es significativa porque está diseñada para ser útil en una amplia gama de dispositivos. El conjunto de instrucciones también tiene un cuerpo sustancial de software de soporte, que evita una debilidad habitual de los nuevos conjuntos de instrucciones. El proyecto comenzó en 2010 en la Universidad de California en Berkeley, pero muchos colaboradores son voluntarios y trabajadores de la industria fuera de la universidad. El conjunto de instrucciones se ha diseñado pensando en implementaciones pequeñas, rápidas y de bajo consumo para el mundo real, pero sin una sobre-ingeniería excesiva que buscase una microarquitectura concreta. En mayo de 2017, estaba cerrada la versión 2.2 del conjunto de instrucciones del espacio de usuario. El conjunto de instrucciones privilegiadas estaba disponible como borrador en la versión 1.10. (es)
- RISC-V (pronounced "risk-five" where five refers to the number of generations of RISC architecture that were developed at the University of California, Berkeley since 1981) is an open standard instruction set architecture (ISA) based on established RISC principles. Unlike most other ISA designs, RISC-V is provided under open source licenses that do not require fees to use. A number of companies are offering or have announced RISC-V hardware, open source operating systems with RISC-V support are available, and the instruction set is supported in several popular software toolchains. As a RISC architecture, the RISC-V ISA is a load–store architecture. Its floating-point instructions use IEEE 754 floating-point. Notable features of the RISC-V ISA include instruction bit field locations chosen to simplify the use of multiplexers in a CPU, a design that is architecturally neutral, and most-significant bits of immediate values placed at a fixed location to speed sign extension. The instruction set is designed for a wide range of uses. The base instruction set has a fixed length of 32-bit naturally aligned instructions, and the ISA supports variable length extensions where each instruction can be any number of 16-bit parcels in length. Subsets support small embedded systems, personal computers, supercomputers with vector processors, and warehouse-scale 19 inch rack-mounted parallel computers. The instruction set specification defines 32-bit and 64-bit address space variants. The specification includes a description of a 128-bit flat address space variant, as an extrapolation of 32 and 64 bit variants, but the 128-bit ISA remains "not frozen" intentionally, because there is yet so little practical experience with such large memory systems. The project began in 2010 at the University of California, Berkeley, but now many current contributors are volunteers not affiliated with the university. Unlike other academic designs which are typically optimized only for simplicity of exposition, the designers intended that the RISC-V instruction set be usable for practical computers. As of June 2019, version 2.2 of the user-space ISA and version 1.11 of the privileged ISA are frozen, permitting software and hardware development to proceed. The user-space ISA, now renamed the Unprivileged ISA, was updated, ratified and frozen as version 20191213. An external debug specification is available as a draft, version 0.13.2. (en)
- RISC-V (prononcé en anglais « RISC five » et signifiant « RISC cinq ») est une architecture de jeu d'instructions (instruction set architecture ou ISA) RISC ouverte et libre, disponible en versions 32, 64 et 128 bits. Ses spécifications sont ouvertes et peuvent être utilisées librement par l'enseignement, la recherche et l'industrie. Les specifications sont ratifiées de façon ouverte par la communauté internationale des développeurs. RISC-V est implémenté dans différents SoC, à destination de l'embarqué, des objets connectés (supportés par différents systèmes temps réel ou à destination de l'embarqué, tels que Arduino, FreeRTOS, HarmonyOS, LiteOS, NuttX, RT-Thread, , Zephyr…), d'ordinateurs légers sous forme de SBC, généralement avec Linux (Debian, Fedora, Ubuntu) ou encore des variantes d'OpenWrt, ainsi qu'Haiku, FreeBSD, NetBSD et OpenBSD et de serveurs, et un projet européen initié en 2019, vise à l'utiliser dans des supercalculateurs domestiques comme accélérateurs au sein de SoC basse consommation développés localement et fonctionnant sous GNU/Linux, comme la grande majorité des supercalculateurs. (fr)
- RISC-V("리스크 파이브"로 발음)는 축소 명령어 집합 컴퓨터(RISC) 기반의 개방형 명령어 집합(ISA)이다. 대부분의 ISA와 달리 RISC-V ISA는 어떠한 목적으로는 자유로이 사용할 수 있으며, 누구든지 RISC-V 칩과 소프트웨어를 설계, 제조, 판매할 수 있게 허가되어 있다. 최초의 개방형 ISA는 아니지만 웨어하우스 규모의 클라우드 컴퓨터, 고성능 휴대 전화, 초소형 임베디드 시스템에 이르는 현대의 산술 장치에 유용하게 쓰일 수 있게 설계되어 있다. 이러한 이용에 근거하여 설계자들은 성능과 전력 효율성을 둘 다 고려하였다. 명령어 집합은 또한 지원 소프트웨어의 실질적인 부분을 포함하고 있어서 새로운 명령어 집합의 일반적인 약점을 보완한다. 이 프로젝트는 캘리포니아 대학교 버클리에서 2010년에 시작되었으나 수많은 기여자들은 자발적인 봉사자들이자 대학 밖의 산업 노동자들이다. RISC-V ISA는 실생활의 소형, 고속, 저전력 구현체를 염두에 두고 설계되었으나, 특정 마이크로아키텍처 스타일을 따르지는 않았다. 2017년 5월 기준으로 버전 2.2의 유저스페이스 ISA가 픽스되어 있으며 privileged ISA는 초안판 1.10으로 이용이 가능하다. (ko)
- RISC-V (Engelse uitspraak: risk-five) is een instructiesetarchitectuur (ISA) die op het principe van een reduced instruction set computer (RISC) is gebaseerd. Het is een open standaard met een BSD-licentie, wat betekent dat RISC-V niet gepatenteerd is en vrij kan worden gebruikt. Zo mag iedereen RISC-V-microprocessors (als opensourcehardware) ontwerpen, produceren, ontwikkelen en verkopen. Een aantal bedrijven biedt of heeft al RISC-V-hardware aangekondigd. (nl)
- Il RISC-V (pronunciato: «risc-five») è uno standard aperto di insieme di istruzioni (ISA, dall'inglese instruction set architecture) basato sul principio reduced instruction set computer (RISC). A differenza di molti altri ISA, il RISC-V è pubblicato sotto licenza open source, pertanto non richiede l'acquisto di una licenza per essere utilizzato. Molte aziende offrono o hanno annunciato hardware basato su questo standard, alcuni sistemi operativi open source sono disponibili e l'insieme d'istruzioni è supportato da diversi toolchain. Il progetto è iniziato nel 2010 all'Università della California, Berkeley, ma molti contributori sono volontari non affiliati all'istituto. A differenza di altri design accademici, generalmente ottimizzati per la pura semplicità d'esposizione, i progettisti di questo standard hanno permesso che possa essere utilizzato per computer pratici. A giugno 2019, le versioni 2.2 dello user-space dell'ISA e 1.1 dell'ISA privilegiato sono , permettendo il proseguimento dello sviluppo di hardware e software. È disponibile la bozza della specifica di debug, alla versione 0.3. (it)
- RISC-V（リスク ファイブ）は、確立された縮小命令セットコンピュータ (RISC) の原則に基づいたオープン標準の命令セットアーキテクチャ (ISA) である。他の多くのISA設計とは異なり、RISC-V ISAは、使用料のかからないオープンソースライセンスで提供されている。多くの企業がRISC-Vハードウェアを提供したり、発表したりしており、RISC-Vをサポートするオープンソースのオペレーティングシステムが利用可能であり、いくつかの一般的なソフトウェアツールチェーンで命令セットがサポートされている。 RISC-V ISAの注目すべき特徴は、ロードストア・アーキテクチャ、CPU内のマルチプレクサを簡素化するビットパターン、IEEE 754浮動小数点、アーキテクチャ的に中立な設計、符号拡張を高速化するために最上位ビットを固定位置に配置することなどである。命令セットは、幅広い用途に対応できるように設計されている。可変幅で拡張可能なので、常により多くのエンコーディングビットを追加することができる。32、64、128ビットの3つのワード幅と、さまざまなサブセットをサポートしている。各サブセットの定義は、3つのワード幅によって若干異なる。サブセットは、小型の組み込みシステム、パーソナルコンピュータ、ベクトルプロセッサを搭載したスーパーコンピュータ、倉庫規模の19インチラックマウント並列コンピュータをサポートしている。 ISAの128ビット伸張版の命令セットスペースが確保されたのは、60年にわたる業界の経験から、最も回復不可能な命令セット設計上の誤りはメモリに対するアドレス空間の不足であることが示されているからである。2016年時点で、128ビットISAは意図的に未定義のままであるが、これは、このような大規模なメモリシステムでの実用的な経験がまだほとんどないためである。 このプロジェクトは2010年にカリフォルニア大学バークレー校で開始されたが、貢献者の多くは大学とは関係のないボランティアである。他のアカデミックな設計は、一般的に説明を簡単にするためだけに最適化されているのに対し、RISC-Vの命令セットは、実用的なコンピュータで使用できるように設計されている。 2019年6月の時点で、ユーザスペースISAのバージョン2.2と特権ISAのバージョン1.11は凍結されており、ソフトウェアとハードウェアの開発を進めることができる。デバッグ仕様は、ドラフトとしてバージョン0.13.2が用意されている。 (ja)
- RISC-V – otwarty model programowy procesora (ISA) oparty o zasady RISC. W kontraście do większości ISA, RISC-V może być swobodnie używany w dowolnym celu, umożliwiając każdemu projektowanie, produkcję i sprzedaż czipów i oprogramowania RISC-V. Chociaż nie jest pierwszą otwartą architekturą ISA ma duże znaczenie, ponieważ został zaprojektowany z myślą o nowoczesnych skomputeryzowanych urządzeniach, takich jak ogromne chmury obliczeniowe, wysokiej klasy telefony komórkowe i najmniejsze systemy wbudowane. Takie zastosowania wymagają zarówno wydajności, jak i efektywności energetycznej. Zestaw instrukcji zawiera również znaczną ilość oprogramowania wspomagającego, które pozwala uniknąć słabości nowych zestawów instrukcji. Projekt rozpoczął się w 2010 r. na Uniwersytecie Kalifornijskim w Berkeley, ale wielu współpracowników to wolontariusze i pracownicy sektora poza uniwersytetem. RISC-V ISA został zaprojektowany z myślą o małych, szybkich i energooszczędnych implementacjach w świecie rzeczywistym, ale bez nadmiernego projektowania dla konkretnego stylu mikroarchitektury. 7 maja 2017 zostały opublikowane wersja 2.2 ISA przestrzeni użytkownika oraz wersja robocza 1.10 uprzywilejowanego ISA. (pl)
- RISC-V é um conjunto de instruções (ISA) baseado em princípios RISC (acrônimo de Reduced Instruction Set Computing, em português, “Computação de conjunto de instruções reduzidas”). RISC-V é livre para ser usado para qualquer finalidade, permitindo a qualquer pessoa ou empresa projetar e vender chips e software RISC-V sem precisar pagar royalties. Embora não seja o primeiro conjunto de instruções livre, ele é importante porque foi projetado com foco para dispositivos computadorizados modernos, como computação em nuvem, aparelhos móveis, sistemas embarcados e internet das coisas. O conjunto também possui uma gama considerável de software de suporte, o que evita um problema usual de novos conjuntos de instruções. O projeto começou em 2010 na Universidade da Califórnia, em Berkeley, mas muitos colaboradores são voluntários ou fazem parte de outra empresas e trabalham no projeto de fora da universidade. O RISC-V foi projetado para implementações de alto desempenho e baixo consumo de energia. Sendo um conjunto limpo e modular, trabalhando com bases de 32, 64 e 128 bits, com várias opções de extensão em ponto flutuante. (pt)
- RISC-V — расширяемая открытая и свободная система команд и процессорная архитектура на основе концепции RISC для микропроцессоров и микроконтроллеров. Архитектура доступна для свободного и бесплатного использования, включая коммерческие реализации непосредственно в кремнии или конфигурировании ПЛИС. Имеет зарезервированные в спецификации биты кодировки для расширения списка команд. Стартовала в 2010 году как исследовательский проект при непосредственном участии Дэвида Паттерсона в Калифорнийском университете Беркли в США. В настоящее время, многие нынешние участники проектов развития RISC-V являются добровольцами, не связанными с университетом. В отличие от других академических проектов, которые обычно сосредоточены на простоте и образовательных целях, в набор команд RISC-V сразу проектируется для широкого круга компьютерных применений. Для устойчивого развития, стандартизации и продвижения RISC-V в 2015 году создан международный фонд RISC-V и ассоциация со штаб-квартирой в Цюрихе в Швейцарии. С 2018 года RISC-V Foundation работает в тесном партнёрстве с The Linux Foundation. В руководство и технические комитеты входят две русские компании разработчики процессорных ядер -- Syntacore и CloudBEAR. В феврале 2022 года компания Intel объявила об инвестировании в развитие RISC-V одного миллиарда долларов и вошла в состав руководства RISC-V. В сентябре 2022 года в России образован Альянс RISC-V. По состоянию на декабрь 2022 года 13 из 25 мест в совете директоров RISC-V занимают китайский компании и организации, ведущую роль из которых занимает китайская академия наук. Базовая спецификация RISC-V включает сравнительно небольшое число команд — стандартный набор из 39 целочисленных инструкций RV32I, стандартные расширения (M, A, F и D) добавляют набор из 53 инструкций, сжатый формат (расширение C) добавляет 34 команды для удвоения плотности упаковки в машинном слове наиболее востребованных стандартных инструкций. Используется 6 типов кодирования инструкций (форматов). (ru)
- RISC-V (uttalas "risk-five" på engelska) är en öppen processorarkitektur.Den finns huvudsakligen i två varianter: RV32 för 32 bitar och RV64 för 64 bitar. Det finns också en preliminär definition av en 128-bitarsvariant. Utvecklingen startade på University of California, Berkeley sommaren 2010.Namnet RISC-V kommer av att det är universitetets femte arkitektur av RISC-typ.Nu drivs utvecklingen av RISC-V Foundation och dess medlemmar. Arkitekturen designades för att vara flexibel och enkel att utöka.Ett av de ursprungliga målen med utvecklingen av RISC-V var att underlätta forskning och utbildning kring processorarkitekturer. (sv)
- RISC-V（发音为“risk-five”）是一個基于精简指令集（RISC）原则的开源指令集架構（ISA），簡易解釋為開源軟體運動相對應的一種「開源硬體」。该项目2010年始于加州大學柏克萊分校，但许多贡献者是该大学以外的志愿者和行业工作者。 与大多数指令集相比，RISC-V指令集可以自由地用于任何目的，允许任何人设计、制造和销售RISC-V芯片和软件而不必支付給任何公司專利費。虽然这不是第一个开源指令集，但它具有重要意义，因为其设计使其适用于现代计算设备（如仓库规模云计算机、高端移动电话和微小嵌入式系统）。设计者考虑到了这些用途中的性能与功率效率。该指令集还具有众多支持的软件，这解决了新指令集通常的弱点。 RISC-V指令集的设计考虑了小型、快速、低功耗的现实情況來實做，但並没有对特定的微架構做过度的設計。截至2017年5月RISC-V已經確立了版本2.22的用户空间的指令集(userspace ISA)，而特权指令集(privileged ISA)也处在草案版本1.10。 (zh)
- RISC-V (вимовляється "risk-five") — відкрита архітектура інструкцій центрального процесора, що базується на принципах RISC. Проект розпочався у 2010 році в Університеті Каліфорнії (Берклі), до роботи долучилися також багато ентузіастів поза межами університету. Станом на травень 2017 року, архітектура команд для програм користувача має версію 2.2, в той час як привілейована частина (для використання ядром операційної системи) поки є чорновою версією 1.10. (uk)
|
| rdfs:comment
|
- ريسك-فايف (بالإنجليزية: RISC-V) هي بنية مجموعة تعليمات (Instructions Set Architecture) حرة ومفتوحة المصدر تستند إلى مبادئ الحوسبة المحددة ريسك. خلاف مُعظم معايير بينة مجموعة التعليمات (ISA) يمكن استخدام معيار RISC-V ISA بحرية لأي غرض، ما يعني حرية كاملة في تصميم وتصنيع وبيع رقائق ريسك-فايف وبرمجتها. لا يُعتبر ريسك-فايف أول بنية مجموعة تعليمات مفتوحة، وتكمل أهميته في أنه صُمم ليستعمل على مجموعة واسعة الأجهزة. تحتوي مجموعة التعليمات أيضًا على مجموعة كبيرة من برامج الدعم، والتي تتجنب الضعف المعتاد في مجموعات التعليمات الجديدة. بدأ المشروع في عام 2010 في جامعة كاليفورنيا بـبيركلي، ولكن العديد من المساهمين هم من المتطوعين وعمال الصناعة خارج الجامعة. صُمم جهاز RISC-V ISA مع تطبيقات في العالم الحقيقي صغيرة وسريعة وقليلة الطاقة، ولكن بدون تصميم معماري أكثر من أجل أسلوب معماري دقيق معين. (ar)
- RISC-V és una arquitectura de joc d'instruccions o ISA basada en codi obert i de tipus RISC. RISC-V fou creada el 2010 per investigadors de la Universitat de Berkeley a Califòrnia. (ca)
- RISC-V (Engelse uitspraak: risk-five) is een instructiesetarchitectuur (ISA) die op het principe van een reduced instruction set computer (RISC) is gebaseerd. Het is een open standaard met een BSD-licentie, wat betekent dat RISC-V niet gepatenteerd is en vrij kan worden gebruikt. Zo mag iedereen RISC-V-microprocessors (als opensourcehardware) ontwerpen, produceren, ontwikkelen en verkopen. Een aantal bedrijven biedt of heeft al RISC-V-hardware aangekondigd. (nl)
- RISC-V（发音为“risk-five”）是一個基于精简指令集（RISC）原则的开源指令集架構（ISA），簡易解釋為開源軟體運動相對應的一種「開源硬體」。该项目2010年始于加州大學柏克萊分校，但许多贡献者是该大学以外的志愿者和行业工作者。 与大多数指令集相比，RISC-V指令集可以自由地用于任何目的，允许任何人设计、制造和销售RISC-V芯片和软件而不必支付給任何公司專利費。虽然这不是第一个开源指令集，但它具有重要意义，因为其设计使其适用于现代计算设备（如仓库规模云计算机、高端移动电话和微小嵌入式系统）。设计者考虑到了这些用途中的性能与功率效率。该指令集还具有众多支持的软件，这解决了新指令集通常的弱点。 RISC-V指令集的设计考虑了小型、快速、低功耗的现实情況來實做，但並没有对特定的微架構做过度的設計。截至2017年5月RISC-V已經確立了版本2.22的用户空间的指令集(userspace ISA)，而特权指令集(privileged ISA)也处在草案版本1.10。 (zh)
- RISC-V (вимовляється "risk-five") — відкрита архітектура інструкцій центрального процесора, що базується на принципах RISC. Проект розпочався у 2010 році в Університеті Каліфорнії (Берклі), до роботи долучилися також багато ентузіастів поза межами університету. Станом на травень 2017 року, архітектура команд для програм користувача має версію 2.2, в той час як привілейована частина (для використання ядром операційної системи) поки є чорновою версією 1.10. (uk)
- RISC-V (výslovnost [ˌrisk ˈfaiv]; V je římská číslice 5) je instrukční sada z rodiny RISC. Je vyvíjena od roku 2010 na Kalifornské univerzitě v Berkeley. Původně šlo o “tříměsíční projekt”, který měl vytvořit novou otevřenou instrukční sadu (architekturu) na základě existujících technologií a překonat tak omezení související s proprietárními architekturami, mezi něž patří: (cs)
- RISC-V, offizielle Aussprache in Englisch: „risc-five“ [rɪsk faɪv], ist eine Befehlssatzarchitektur (engl. instruction set architecture, ISA), die sich auf das Designprinzip des Reduced Instruction Set Computers (RISC) stützt. Es ist ein offener Standard, welcher der freizügigen BSD-Lizenz unterliegt. Das bedeutet, dass RISC-V nicht patentiert ist und frei verwendet werden darf. Somit ist es jedem erlaubt, RISC-V Mikroprozessoren zu entwerfen, herzustellen, weiterzuentwickeln und zu verkaufen (Open-Source-Hardware). Eine Vielzahl an Unternehmen bieten RISC-V-Hardware an oder haben diese angekündigt. (de)
- RISC-V es una arquitectura de conjunto de instrucciones (ISA) de hardware libre basado en un diseño de tipo RISC (conjunto de instrucciones reducido). A diferencia de la mayoría de los conjuntos de instrucciones, el de RISC-V es libre y abierto y se puede usar sin regalías para cualquier propósito, lo que permite que cualquiera diseñe, fabrique y venda chips y software de RISC-V. Si bien no es la primera ISA de arquitectura abierta, es significativa porque está diseñada para ser útil en una amplia gama de dispositivos. El conjunto de instrucciones también tiene un cuerpo sustancial de software de soporte, que evita una debilidad habitual de los nuevos conjuntos de instrucciones. (es)
- RISC-V (risc-five ahoskatua, Kaliforniako Unibertsitatean (Berkeley, 1981) garatu ziren RISC arkitekturan oinarritutako 5.belaunaldien kopuruari dagokio. Estandar irekien agindu-multzo arkitektura da (ISA ingelesez), RISCn ezarritako printzipioetan oinarritua. Beste diseinu gehienetan ez bezala, RISC-V bidez ematen da, erabiltzeko tasarik behar ez dutenak. Zenbait konpainia RISC-V-en oinarritutako hardwarea eskaintzen dute edo iragartzen ari dira, RISC-V euskarria duten kode irekiko sistema eragileak sortu dira, eta agindu-multzoa hainbat software famatu eta tresna-katetan euskarria du. (eu)
- RISC-V (pronounced "risk-five" where five refers to the number of generations of RISC architecture that were developed at the University of California, Berkeley since 1981) is an open standard instruction set architecture (ISA) based on established RISC principles. Unlike most other ISA designs, RISC-V is provided under open source licenses that do not require fees to use. A number of companies are offering or have announced RISC-V hardware, open source operating systems with RISC-V support are available, and the instruction set is supported in several popular software toolchains. (en)
- RISC-V (prononcé en anglais « RISC five » et signifiant « RISC cinq ») est une architecture de jeu d'instructions (instruction set architecture ou ISA) RISC ouverte et libre, disponible en versions 32, 64 et 128 bits. Ses spécifications sont ouvertes et peuvent être utilisées librement par l'enseignement, la recherche et l'industrie. Les specifications sont ratifiées de façon ouverte par la communauté internationale des développeurs. (fr)
- Il RISC-V (pronunciato: «risc-five») è uno standard aperto di insieme di istruzioni (ISA, dall'inglese instruction set architecture) basato sul principio reduced instruction set computer (RISC). A differenza di molti altri ISA, il RISC-V è pubblicato sotto licenza open source, pertanto non richiede l'acquisto di una licenza per essere utilizzato. Molte aziende offrono o hanno annunciato hardware basato su questo standard, alcuni sistemi operativi open source sono disponibili e l'insieme d'istruzioni è supportato da diversi toolchain. (it)
- RISC-V("리스크 파이브"로 발음)는 축소 명령어 집합 컴퓨터(RISC) 기반의 개방형 명령어 집합(ISA)이다. 대부분의 ISA와 달리 RISC-V ISA는 어떠한 목적으로는 자유로이 사용할 수 있으며, 누구든지 RISC-V 칩과 소프트웨어를 설계, 제조, 판매할 수 있게 허가되어 있다. 최초의 개방형 ISA는 아니지만 웨어하우스 규모의 클라우드 컴퓨터, 고성능 휴대 전화, 초소형 임베디드 시스템에 이르는 현대의 산술 장치에 유용하게 쓰일 수 있게 설계되어 있다. 이러한 이용에 근거하여 설계자들은 성능과 전력 효율성을 둘 다 고려하였다. 명령어 집합은 또한 지원 소프트웨어의 실질적인 부분을 포함하고 있어서 새로운 명령어 집합의 일반적인 약점을 보완한다. 이 프로젝트는 캘리포니아 대학교 버클리에서 2010년에 시작되었으나 수많은 기여자들은 자발적인 봉사자들이자 대학 밖의 산업 노동자들이다. RISC-V ISA는 실생활의 소형, 고속, 저전력 구현체를 염두에 두고 설계되었으나, 특정 마이크로아키텍처 스타일을 따르지는 않았다. (ko)
- RISC-V（リスク ファイブ）は、確立された縮小命令セットコンピュータ (RISC) の原則に基づいたオープン標準の命令セットアーキテクチャ (ISA) である。他の多くのISA設計とは異なり、RISC-V ISAは、使用料のかからないオープンソースライセンスで提供されている。多くの企業がRISC-Vハードウェアを提供したり、発表したりしており、RISC-Vをサポートするオープンソースのオペレーティングシステムが利用可能であり、いくつかの一般的なソフトウェアツールチェーンで命令セットがサポートされている。 ISAの128ビット伸張版の命令セットスペースが確保されたのは、60年にわたる業界の経験から、最も回復不可能な命令セット設計上の誤りはメモリに対するアドレス空間の不足であることが示されているからである。2016年時点で、128ビットISAは意図的に未定義のままであるが、これは、このような大規模なメモリシステムでの実用的な経験がまだほとんどないためである。 このプロジェクトは2010年にカリフォルニア大学バークレー校で開始されたが、貢献者の多くは大学とは関係のないボランティアである。他のアカデミックな設計は、一般的に説明を簡単にするためだけに最適化されているのに対し、RISC-Vの命令セットは、実用的なコンピュータで使用できるように設計されている。 (ja)
- RISC-V – otwarty model programowy procesora (ISA) oparty o zasady RISC. W kontraście do większości ISA, RISC-V może być swobodnie używany w dowolnym celu, umożliwiając każdemu projektowanie, produkcję i sprzedaż czipów i oprogramowania RISC-V. Chociaż nie jest pierwszą otwartą architekturą ISA ma duże znaczenie, ponieważ został zaprojektowany z myślą o nowoczesnych skomputeryzowanych urządzeniach, takich jak ogromne chmury obliczeniowe, wysokiej klasy telefony komórkowe i najmniejsze systemy wbudowane. Takie zastosowania wymagają zarówno wydajności, jak i efektywności energetycznej. Zestaw instrukcji zawiera również znaczną ilość oprogramowania wspomagającego, które pozwala uniknąć słabości nowych zestawów instrukcji. (pl)
- RISC-V é um conjunto de instruções (ISA) baseado em princípios RISC (acrônimo de Reduced Instruction Set Computing, em português, “Computação de conjunto de instruções reduzidas”). RISC-V é livre para ser usado para qualquer finalidade, permitindo a qualquer pessoa ou empresa projetar e vender chips e software RISC-V sem precisar pagar royalties. O projeto começou em 2010 na Universidade da Califórnia, em Berkeley, mas muitos colaboradores são voluntários ou fazem parte de outra empresas e trabalham no projeto de fora da universidade. (pt)
- RISC-V (uttalas "risk-five" på engelska) är en öppen processorarkitektur.Den finns huvudsakligen i två varianter: RV32 för 32 bitar och RV64 för 64 bitar. Det finns också en preliminär definition av en 128-bitarsvariant. Utvecklingen startade på University of California, Berkeley sommaren 2010.Namnet RISC-V kommer av att det är universitetets femte arkitektur av RISC-typ.Nu drivs utvecklingen av RISC-V Foundation och dess medlemmar. (sv)
- RISC-V — расширяемая открытая и свободная система команд и процессорная архитектура на основе концепции RISC для микропроцессоров и микроконтроллеров. Архитектура доступна для свободного и бесплатного использования, включая коммерческие реализации непосредственно в кремнии или конфигурировании ПЛИС. Имеет зарезервированные в спецификации биты кодировки для расширения списка команд. (ru)
|
